SOC設計實驗箱融合FPGA數字系統設計和SOC開發應用的企業級項目案例,為學生提供創新創業開發平臺,為老師提供橫向課題開發環境。


SOC設計實驗箱采用企業真實工程型項目開發環境,硬件邏輯資源豐富,可滿足各類FPGA應用場景的環境搭建。同時搭配4核ARM內核,可滿足SOC系統級設計需求,鞏固Verilog HDL硬件描述語言語法知識,同時熟悉Modelsim軟件、Vivado軟件等FPGA工具的開發流程,充分掌握邏輯設計、功能仿真、布局布線、時序仿真、硬件驗證等相關測試驗證方法, 拆分自真實項目的實驗案例。


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