基于運算放大器的阻性傳感器陣列讀出電路及其讀出方法

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本發(fā)明公開了一種基于運算放大器的阻性傳感器陣列讀出電路，所述阻性傳感器陣列為共用行線和列線的阻性傳感器陣列；該讀出電路包括：標準電阻行，其包括一行N個標準電阻，增設于所述阻性傳感器陣列中，從而得到一個新的共用行線和列線的（M+1）×N電阻陣列；（M+1）個運算放大器，與電阻陣列的（M+1）條行線一一對應，每個運算放大器的反相輸入端、輸出端連接于一點后與其所對應行線連接；控制器，其具有至少(M+1)個IO端口以及至少N個ADC采樣端口，其中的(M+1)個IO端口與所述（M+1）個運算放大器的同相輸入端

小批量或小范圍應用

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